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Fecha de PublicaciónTítuloAutor(s)
2015?How Can I Help You?? Preliminary Studies About User Strategies and Preferences During a GameCaroline Santos; Luana Müller; Angelina Ziesemer; Espindola, Luciana; Pedro A. Pires, etc.
2015Users Impressions about Visualization Techniques in Social Networks ContextEduardo Ghidini; Elisa Costa Diel; João Pedro Dewes Guterres; Greice Roman; Milene Selbach Silveira
2014Objetos de Aprendizagem como elementos facilitadores na Educação a DistânciaMara Lucia Fernandes Carneiro; Milene Selbach Silveira
2012?Eu vi o que você fez... e eu sei quem você é!?: uma análise sobre privacidade no Facebook do ponto de vista dos usuárioFrancine Bülow Bergmann; Milene Selbach Silveira
2011User-Centered Design and Agile Methods: A Systematic ReviewTiago Silva da Silva; Frank Maurer; Angela Martin; Milene Selbach Silveira
2012Objetos de aprendizagem sob o ponto de vista dos alunos:um estudo de casoMára Lúcia Fernandes Carneiro; Milene Selbach Silveira
2014A Influência da Área de Atuação do Professor na Interface de Objetos de Aprendizagem por ele IdealizadosDiogo Israel Schwanck; Mára Lúcia Fernandes Carneiro; Milene Selbach Silveira
2011Diretrizes para Elaboração de Mensagens de Erro ConstrutivasDaniela Bugs; Márcia Borges Veiga; Milene Selbach Silveira
2012Ensino de IHC ? Compartilhando as Experiências Docentes no Contexto BrasileiroSilvia Amélia Bim; Milene Selbach Silveira; Raquel de Oliveira Prates
2016Estou Fazendo Pós-Graduação em IHC... e agora?Milene Selbach Silveira; Simone DJ Barbosa
2011WEIHC 2011 - II Workshop sobre o Ensino de IHCSilvia Amélia Bim; Milene Selbach Silveira; Raquel de Oliveira Prates; Marco Winckler
2011?Afinando? a comunicação entre pares para melhorar a compreensão da mensagem do designerLeticia Lopes Leite; Milene Selbach Silveira
2012Desconstruindo Objetos de Aprendizagem: reflexões sobre sua qualidade de usoMilene Selbach Silveira; Mára Lúcia Fernandes Carneiro
2016Design and Analysis of the HF-RISC Processor Targeting Voltage Scaling ApplicationsFelipe Bortolon; Matheus Gibiluka; Sérgio Johann Filho; Sergio Bampi; Ney Laert Vilar Calazans, etc.
2012E agora, quem poderá me ajudar? Utilizando sistemas de recomendação para otimização do processo de busca por auxílio em ambientes colaborativos de ensinoLuana Müller; Milene Selbach Silveira
2012Diretrizes para a Avaliação da Usabilidade de Objetos de AprendizagemMilene Selbach Silveira; Mára Lúcia Fernandes Carneiro
2017A Comparison of Asynchronous QDI Templates Using Static LogicRicardo Aquino Guazzelli; Matheus Trevisan Moreira; Ney Laert Vilar Calazans
2017Go Functional Model for a RISC-V Asynchronous Organization - ARVMarcos Luiggi Lemos Sartori; Ney Laert Vilar Calazans
2012Inspeção Semiótica e Avaliação de Comunicabilidade: identificando falhas de comunicabilidade sobre as configurações de privacidade do FacebookJuliano Varella de Carvalho; Felipe Lammel; Janaína Dias da Silva; Lucélia Cynthia Chipeaux; Milene Selbach Silveira
2011Best Practices for Integrating User-Centered Design and Agile Software DevelopmentTiago Silva da Silva; Milene Selbach Silveira; Frank Maurer
2015A Bundled-Data Asynchronous Circuit Synthesis Flow Using a Commercial EDA FrameworkMatheus Gibiluka; Matheus Trevisan Moreira; Ney Laert Vilar Calazans
2015Blade - A Timing Violation Resilient Asynchronous TemplateDylan Hand; Matheus Trevisan Moreira; Hsin-Ho Huang; Danlei Chen; Frederico Butzke, etc.
2017Sleep Convention Logic Isochronic Fork: an AnalysisRicardo Aquino Guazzelli; Walter Lau Neto; Matheus Trevisan Moreira; Ney Laert Vilar Calazans
2016Analysis and Design of Delay Lines for Dynamic Voltage Scaling ApplicationsRamy Nagy Tadros; Weizhe Hua; Matheus Gibiluka; Matheus Trevisan Moreira; Ney Laert Vilar Calazans, etc.
2015A Fine-Grained, Uniform, Energy-Efficient Delay Element for FD-SOI TechnologiesAjay Singhvi; Matheus Trevisan Moreira; Ramy Nagy Tadros; Ney Laert Vilar Calazans; Peter Anthony Beerel
2015Analysis and Optimization of Programmable Delay Elements for 2-Phase Bundled-Data CircuitsGuilherme Heck; Leandro Sehnem Heck; Ajay Singhvi; Matheus Trevisan Moreira; Ney Laert Vilar Calazans, etc.
2017Hardening C-elements Against MetastabilityLeandro Sehnem Heck; Matheus Trevisan Moreira; Ney Laert Vilar Calazans
2015A Path Towards Average-Case Silicon via Asynchronous Resilient Bundled-data DesignPeter Anthony Beerel; Ney Laert Vilar Calazans
2016ASCEnD-FreePDK45: An Open Source StandardCell Library for Asynchronous DesignCarlos Henrique Menezes Oliveira; Matheus Trevisan Moreira; Ricardo Aquino Guazzelli; Ney Laert Vilar Calazans
2016Early Approaches to Anaphora Resolution: Theoretically Inspired and Heuristic-BasedMassimo Poesio; Stuckardt, Roland; Versley, Yannick; Renata Vieira
2014A New CMOS Topology for Low-Voltage Null Convention Logic Gates DesignMatheus Trevisan Moreira; Michel Evandro Arendt; Ricardo Aquino Guazzelli; Ney Laert Vilar Calazans
2015Performance Optimization and Analysis of Blade Designs Under Delay VariabilityDylan Hand; Hsin-Ho Huang; Benmao Cheng; Yang Zhang; Matheus Trevisan Moreira, etc.
2017An Algorithm for Allocating Structured Tasks in Multi-Robot ScenariosTulio L. Basegio; Rafael Heitor Bordini
2013Design of NCL Gates with the ASCEnD FlowMatheus Trevisan Moreira; Carlos Henrique Menezes Oliveira; Ricardo Cademartori Porto; Ney Laert Vilar Calazans
2014Quasi-Delay-Insensitive Return-to-One DesignMatheus Trevisan Moreira; Ney Laert Vilar Calazans
2015Tradeoffs Between RTO and RTZ in WCHB QDI Asynchronous DesignMatheus Trevisan Moreira; Julian José Hilgemberg Pontes; Ney Laert Vilar Calazans
2014Automated Synthesis of Cell Libraries for Asynchronous CircuitsMatheus Trevisan Moreira; Michel Evandro Arendt; Adriel Ziesemer Jr.; Ricardo Augusto da Luz Reis; Ney Laert Vilar Calazans
2015SDDS-NCL Design: Analysis of Supply Voltage ScalingRicardo Aquino Guazzelli; Fernando Gehm Moraes; Ney Laert Vilar Calazans; Matheus Trevisan Moreira
2014Hardening QDI Circuits Against Transient Faults Using Delay-Insensitive Maxterm SynthesisMatheus Trevisan Moreira; Ricardo Aquino Guazzelli; Guilherme Heck; Ney Laert Vilar Calazans
2015TDTB Error Detecting Latches: Timing Violation Sensitivity Analysis and OptimizationMatheus Trevisan Moreira; Dylan Hand; Peter Anthony Beerel; Ney Laert Vilar Calazans
2013A Flexible Soft IP Core for Standard Implementations of Elliptic Curve Cryptography in HardwareBruno Fin Ferreira; Ney Laert Vilar Calazans
2014Automatic Layout Synthesis with ASTRAN Applied to Asynchronous CellsAdriel Ziesemer Jr.; Ricardo Augusto da Luz Reis; Matheus Trevisan Moreira; Michel Evandro Arendt; Ney Laert Vilar Calazans
2013ASCEnD: A Standard Cell Library for Semi-Custom Asynchronous DesignMatheus Trevisan Moreira; Carlos Henrique Menezes Oliveira; Ney Laert Vilar Calazans
2014A Design Flow for Physical Synthesis of Digital Cells with ASTRANAdriel Ziesemer Jr.; Ricardo Augusto da Luz Reis; Matheus Trevisan Moreira; Michel Evandro Arendt; Ney Laert Vilar Calazans
2013Parity Check for m-of-n Delay Insensitive CodesJulian José Hilgemberg Pontes; Ney Laert Vilar Calazans; Pascal Vivet
2014Semi-custom NCL Design with Commercial EDA Frameworks: Is it Possible?Matheus Trevisan Moreira; Augusto Neutzling Silva; Mayler Gama Alvarenga Martins; André Inácio Reis; Renato Perez Ribas, etc.
2013LiChEn: Automated Electrical Characterization of Asynchronous Standard Cell LibrariesMatheus Trevisan Moreira; Carlos Henrique Menezes Oliveira; Ney Laert Vilar Calazans; Luciano Copello Ost
2012Adding Temporal Redundancy to Delay Insensitive Codes to Mitigate Single Event EffectsPONTES, JULIAN; Ney Laert Vilar Calazans; VIVET, PASCAL
2013H2A: A Hardened Asynchronous Network on ChipJulian José Hilgemberg Pontes; Ney Laert Vilar Calazans; Pascal Vivet
2014Schmitt Trigger on Output Inverters of NCL Gates for Soft Error Hardening: is it Enough?Ricardo Aquino Guazzelli; Guilherme Heck; Matheus Trevisan Moreira; Ney Laert Vilar Calazans
2012An accurate Single Event Effect digital design flow for reliable system level designPONTES, J.; Ney Laert Vilar Calazans; Pascal Vivet
2013NCL+: Return-to-One Null Convention LogicMatheus Trevisan Moreira; Carlos Henrique Menezes Oliveira; Ricardo Cademartori Porto; Ney Laert Vilar Calazans
2013Design of Standard-Cell Libraries for Asynchronous Circuits with the ASCEnD FlowMatheus Trevisan Moreira; Ney Laert Vilar Calazans
2013Voltage Scaling on C-Elements: A Speed, Power and Energy Efficiency AnalysisMatheus Trevisan Moreira; Ney Laert Vilar Calazans
2017Portuguese Personal Story Analysis and Detection in BlogsHenrique Dias; Vinicius Woloszyn; Renata Vieira
2017Collective elaboration of a coreference annotated corpus for portuguese textsEvandro Brasil Fonseca; Sandra Collovini de Abreu; Vinicius Sesti; Ana Luisa Leal; Paulo Quaresma, etc.
2012Return-to-one protocol for reducing static power in C-elements of QDI circuits employing m-of-n codesMOREIRA, MATHEUS T.; GUAZZELLI, RICARDO A.; Ney Laert Vilar Calazans
2012A spectrum of MPSoC models for design space exploration and its usePETRY, CARLOS A.; WACHTER, EDUARDO W.; DE CASTILHOS, GUILHERME M.; MORAES, FERNANDO G.; Ney Laert Vilar Calazans
2011A 65nm standard cell set and flow dedicated to automated asynchronous circuits designMOREIRA, MATHEUS; OLIVEIRA, BRUNO; PONTES, JULIAN; Ney Laert Vilar Calazans
2012Return-to-One DIMS logic on 4-phase m-of-n asynchronous circuitsMOREIRA, MATHEUS T.; GUAZZELLI, RICARDO A.; Ney Laert Vilar Calazans
2012Electrical characterization of a C-Element with LiChEnMOREIRA, MATHEUS T.; Ney Laert Vilar Calazans
2017Alinhamento entre ontologias de Topo e de Domínio usando WordNetDaniela Schmidt; Cassia Trojahn dos Santos; Renata Vieira
2018Automatic Generation of Multi-Agent Programs from Ontology ModelsArtur Freitas; Rafael Bordini; Renata Vieira
2018Matching domain and top-level ontologies exploring word sense disambiguation and word embeddingDaniela Schmidt; Cassia Trojahn dos Santos; Renata Vieira
2018An initial investigation of the Charlson comorbidity index regression based on clinical notesHenrique Dias; Vinicius Woloszyn; Ana Helena Santos; Renata Vieira
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